负责数字ic设计和验证
负责isp pipeline硬件架构设计及规划
负责将isp algorithm 硬件化
优化isp PPA（power performance an d area）
要求：
本科及以上，电子信息、微电子学、电路与系统、集成电路、通信、计算机、电子工程等相关科系；
3年以上数字ic设计经验；
具备以下经验者优先考虑：isp模块经验、soc整合合成经验、low power经验、ai相关基本知识、验证经验、高级综合、tv、lcd、display设计经验、FPGA设计经验；
良好的verilog编程能力前端EDA tool使用能力；
良好的英语读写能力。
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